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DE2-70 User Manual
1.8V 2.5V 3.3V
JP1
2
1
4
3
6
5
Figure 5.10. JP1 pin settings.
VCCIO5
VCCIO5
(GPIO 0)
J4
1
2
D12
BAT54S
3
GPIO_D0
1
2
D14
BAT54S
3
GPIO_D1
IO_CLKINn0
IO_CLKINp0
IO_A2
IO_A4
IO_A6
1
3
5
7
9
2
4
6
8
10
IO_A0
IO_A1
IO_A3
IO_A5
IO_A7
IO_A8
IO_A10
IO_A12
IO_A16
IO_A18
IO_A20
IO_A22
IO_A24
IO_A26
IO_A28
IO_A30
GPIO_D0 R51 47 IO_A0
GPIO_D1 R52 47 IO_A1
(protection registors and diodes
not shown for other ports)
VCC5
VCC33
11
13
15
17
IO_CLKOUTn0 19
IO_CLKOUTp0 21
23
25
27
29
31
33
35
37
39
12
14
16
18
20
22
24
26
28
30
32
34
36
38
40
IO_A9
IO_A11
IO_A13
IO_A14
IO_A15
IO_A17
IO_A19
IO_A21
IO_A23
IO_A25
IO_A27
IO_A29
IO_A31
BOX Header 2X20M
VCCIO5
VCCIO5
D48
D50
(GPIO 1)
1
3 GPIO_D32
1
3 GPIO_D33
J5
2
BAT54S
2
BAT54S
IO_CLKINn1
IO_CLKINp1
IO_B2
IO_B4
IO_B6
1
3
5
7
9
2
4
6
8
10
IO_B0
IO_B1
IO_B3
IO_B5
IO_B7
15
17
23
25
27
31
33
35
39
GPIO_D32 R60 47 IO_B0
GPIO_D33 R61 47 IO_B1
(protection registors and diodes
not shown for other ports)
VCC5
VCC33
11
IO_B8 13
IO_B10
IO_B12
IO_CLKOUTn1 19
IO_CLKOUTp1 21
IO_B16
IO_B18
IO_B20
29
IO_B22
IO_B24
IO_B26
IO_B28 37
IO_B30
12
14
16
18
20
22
24
26
28
30
32
34
36
38
40
IO_B9
IO_B11
IO_B13
IO_B14
IO_B15
IO_B17
IO_B19
IO_B21
IO_B23
IO_B25
IO_B27
IO_B29
IO_B31
BOX Header 2X20M
Figure 5.11. Schematic diagram of the expansion headers.
Signal Name
IO_A [0]
IO_A [1]
IO_A [2]
FPGA Pin No.
PIN_C30
PIN_C29
PIN_E28
42
Description
GPIO Connection 0 IO[0]
GPIO Connection 0 IO[1]
GPIO Connection 0 IO[2]
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